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    基于DDR內存總線的高速網絡接入技術

    張曉彤 王景存 王沁 劉蘭軍

    張曉彤, 王景存, 王沁, 劉蘭軍. 基于DDR內存總線的高速網絡接入技術[J]. 工程科學學報, 2007, 29(11): 1158-1162. doi: 10.13374/j.issn1001-053x.2007.11.021
    引用本文: 張曉彤, 王景存, 王沁, 劉蘭軍. 基于DDR內存總線的高速網絡接入技術[J]. 工程科學學報, 2007, 29(11): 1158-1162. doi: 10.13374/j.issn1001-053x.2007.11.021
    ZHANG Xiaotong, WANG Jingcun, WANG Qin, LIU Lanjun. High-speed network access technology based on DDR memory bus[J]. Chinese Journal of Engineering, 2007, 29(11): 1158-1162. doi: 10.13374/j.issn1001-053x.2007.11.021
    Citation: ZHANG Xiaotong, WANG Jingcun, WANG Qin, LIU Lanjun. High-speed network access technology based on DDR memory bus[J]. Chinese Journal of Engineering, 2007, 29(11): 1158-1162. doi: 10.13374/j.issn1001-053x.2007.11.021

    基于DDR內存總線的高速網絡接入技術

    doi: 10.13374/j.issn1001-053x.2007.11.021
    基金項目: 

    中國科學院計算所知識創新工程“HPC-OG模擬系統及相關技術”研究項目(No.20036040)

    詳細信息
      作者簡介:

      張曉彤(1968-),男,副教授,博士

    • 中圖分類號: TP393.05

    High-speed network access technology based on DDR memory bus

    • 摘要: 在機群系統中,機群的互連網絡性能對整個機群系統的性能有著至關重要的影響.機群系統要求互連網絡具有高帶寬、低延遲、高可靠等特性,傳統的互連網絡接入方法基本上基于PCI接口.本文提出了基于DDR DIMM內存總線的接入思想,采用可編程邏輯器件FPGA實現網絡接口設計,通過直接讀寫內存方式提高并行接入帶寬,并將部分通訊協議下載到網卡上以提高計算和通訊的速度.實測表明,在不包括上層協議的情況下,接口卡的數據接入帶寬可達3120Mbps,給出了基于FPGA的實現方法,并用Xilinx Virtex-Ⅱ Pro-20 FPGA進行了仿真和驗證.

       

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    出版歷程
    • 收稿日期:  2006-07-31
    • 修回日期:  2006-11-23
    • 網絡出版日期:  2021-08-16

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